ダン ナム カイン

ダン ナム カイン DANG Nam Khanh

彈縮娩

侭奉
コンピュ`タ尖垢僥親/コンピュ`タ垢僥何T
彈縮娩
E-Mail
khanh@u-aizu.ac.jp
Webサイト
https://u-aizu.ac.jp/~khanh/

縮圄

毅輝親朕 - 寄僥
PL03: プログラミングJAVA I (Ex.), Q1.
FU05: コンピュ`タア`キテクチャ (Ex.), Q1.
SE08: ビッグデ`タ蛍裂古(Ex.), Q3.
FU06: オペレ`ティングシステム (Ex.), Q4.
毅輝親朕 - 寄僥垪
SYA14: ニュ`ロモ`フィックコンピュ`ティング Q2.
RPW1: 誘後猟鵡Pセミナ` I, Q3+Q4.

冩梢

冩梢蛍勸
崙囮式びシステム垢僥
徨デバイス式び徨C匂
麻Cシステム
麻親僥
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- コンピュ`タサイエンスとエンジニアリングの鴬平催、賦鴬sunbet郊利_按壇崕靈-和墮|嗄老、晩云、2017定
- 秤鵐轡好謄爐伴斜gの俐平催、パリ及11寄僥、フランス、2014定
- 徨垢僥と宥佚垢僥の僥平催、ベトナム忽社寄僥垢僥室g寄僥、ベトナム、2011定

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- 彈縮娩、賦鴬sunbet郊利_按壇崕靈-和墮|嗄老、2022定4埖゛F壓
- 廁縮娩、ベトナム忽社寄僥垢僥室g寄僥、ハノイ、2017定11埖゛2022定3埖
- 人T冩梢T、賦鴬sunbet郊利_按壇崕靈-和墮|嗄老、2020定11埖゛2021定3埖
- 人T冩梢T、賦鴬sunbet郊利_按壇崕靈-和墮|嗄老、2019定5埖゛2019定9埖
- 冩梢T、SISLAB、ベトナム忽社寄僥ハノイ、2011定゛2014定
- RTLデザイナ`、Dolphin Inc.、2010定゛2011定
F壓の冩梢n}
- ニュ`ロモ`フィックエンジニアリング
- AI
- 詰M薦VLSI
冩梢坪否キ`ワ`ド
ニュ`ロモ`フィックコンピュ`ティング、フォ`ルトトレランス、VLSI、3D鹿e指揃、伏撹A
侭奉僥氏

パ`ソナルデ`タ

僥伏へのメッセ`ジ
児Aを附につけてから、鮄辰盆Mむことが採よりも寄俳だと佚じています。方僥、哂Z、プログラミングなどの児云議な親朕をしっかりとiみ、僥び、するrgを函ってください。この耕な児Pが、Lいキャリアを屶える薦となるでしょう。巌い児Pではなく、しっかりとした輿岬をBくことが嶷勣です。

麼な广?猟

xkされた蒙S:

[P1] A. Ben Abdallah, Khanh N. Dang, An on-chip 3D system in which TSV groups containing multiple TSVs connect layers together [}方のTSVを根むTSVグル`プが嚔gを俊Aするオンチップの3肝圷システム], 蒙S及7488989催, Japan patent.

[P2] A. Ben Abdallah, Khanh N. Dang, Masayuki Hisada, TSV Error Tolerant Router Device for 3D Network On Chip, 蒙S及7239099催, Japan patent.

[P3] Khanh N. Dang, A. Ben Abdallah, ''Homogeneous computing system and migration flow generation program for homogeneous computing device ̄ [ホモジニアスコンピュ`ティングシステム式びホモジニアスコンピュ`ティングデバイスのマイグレ`ションフロ`の伏撹プログラム], 蒙 2022-196416, Japan patent, (patent pending)

[P4] Khanh N. Dang, A. Ben Abdallah, Nguyen Ngo Doanh, ^Neural Network Processor^ [ニュ`ラルネットワ`クプロセッサ], 蒙 2024-047372, Japan patent, (filed patent).

xばれた猟:

[1] Ryoji Kobayashi, Ngo-Doanh Nguyen, Abderazek Ben Abdallah, Nguyen Anh Vu Doan and Khanh N. Dang, ^ApproxiMorph: Energy-efficient Neuromorphic System with Layer-wise Approximation of Spiking Neural Networks and 3D-Stacked SRAM^, IEEE Transactions on Computer-Aided Design of Integrated Circuits and Systems, 2025 (in-press). [DOI: 10.1016/10.1109/TCAD.2025.3597251]

[2] Ngo-Doanh Nguyen, Khanh N. Dang, Akram Ben Ahmed, Abderazek Ben Abdallah, Xuan-Tu Tran, ^NOMA: A Novel Reliability Improvement Methodology for 3-D IC-based Neuromorphic Systems^, IEEE Transactions on Components, Packaging and Manufacturing Technology, 2024 (in-press). [DOI: 10.1109/TCPMT.2024.3488113]

[3] Ngo-Doanh Nguyen, Akram Ben Ahmed, Abderazek Ben Abdallah, Khanh N. Dang, ^Power-aware Neuromorphic Architecture with Partial Voltage Scaling 3D Stacking Synaptic Memory^, IEEE Transactions on Very Large Scale Integration Systems (TVLSI), vol. 31, no. 12, pp. 2016-2029, Dec. 2023.

[4] Khanh N. Dang, Nguyen Anh Vu Doan, Abderazek Ben Abdallah ^MigSpike: A Migration Based Algorithm and Architecture for Scalable Robust Neuromorphic Systems ̄, IEEE Transactions on Emerging Topics in Computing (TETC), [DOI: 10.1109/TETC.2021.3136028].

[5] Khanh N. Dang, Akram Ben Ahmed, Abderazek Ben Abdallah, Xuan-Tu Tran, ^HotCluster: A thermal-aware defect recovery method for Through-Silicon-Vias Towards Reliable 3-D ICs systems ̄, IEEE Transactions on Computer-Aided Design of Integrated Circuits and Systems, IEEE, Volume 41, No. 4, pp. 799-812, April 2022. [DOI: 10.1109/TCAD.2021.3069370].

[6] Khanh N. Dang, Akram Ben Ahmed, Ben Abdallah Abderrazak and Xuan-Tu Tran, ^TSV-OCT: A Scalable Online Multiple-TSV Defects Localization for Real-Time 3-D-IC Systems ̄, IEEE Transactions on Very Large Scale Integration Systems (TVLSI), IEEE, Volume 28, Issue 3, pp. 672 - 685, 2020. [DOI: 10.1109/TVLSI.2019.2948878].

[7] Khanh N. Dang, Akram Ben Ahmed, Yuichi Okuyama, Abderazek Ben Abdallah, ^Scalable design methodology and online algorithm for TSV-cluster defects recovery in highly reliable 3D-NoC systems ̄, IEEE Transactions on Emerging Topics in Computing (TETC), IEEE, Volume 8, Issue 3, pp. 577-590, 2020. [DOI: 10.1109/TETC.2017.2762407].

[8] Khanh N. Dang, Akram Ben Ahmed, Xuan-Tu Tran, Yuichi Okuyama, Abderazek Ben Abdallah, ^A Comprehensive Reliability Assessment of Fault-Resilient Network-on-Chip Using Analytical Model ̄, IEEE Transactions on Very Large Scale Integration Systems (TVLSI), IEEE, Volume 25, Issue 11, pp. 3099-3112, 2017. [DOI: 10.1109/TVLSI.2017.2736004].

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